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PIC18F85J11 FAMILY
DS39774D-page 174
2010 Microchip Technology Inc.
TABLE 16-3:
REGISTERS ASSOCIATED WITH CAPTURE, COMPARE, TIMER1 AND TIMER3
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reset
Values
on page
INTCON
GIE/GIEH PEIE/GIEL TMR0IE
INT0IE
RBIE
TMR0IF
INT0IF
RBIF
57
RCON
IPEN
—
CM
RI
TO
PD
POR
BOR
58
PIR3
—
RC2IF
TX2IF
—
CCP2IF
CCP1IF
—59
PIE3
—
RC2IE
TX2IE
—
CCP2IE
CCP1IE
—59
IPR3
—
RC2IP
TX2IP
—
CCP2IP
CCP1IP
—59
PIR2
OSCFIF
CMIF
—
BCLIF
LVDIF
TMR3IF
—59
PIE2
OSCFIE
CMIE
—
BCLIE
LVDIE
TMR3IE
—59
IPR2
OSCFIP
CMIP
—
BCLIP
LVDIP
TMR3IP
—59
TRISC
TRISC7
TRISC6
TRISC5
TRISC4
TRISC3
TRISC2
TRISC1
TRISC0
60
TRISE
TRISE7
TRISE6
TRISE5
TRISE4
TRISE3
—
TRISE1
TRISE0
60
TRISG
SPIOD
CCP2OD CCP1OD
TRISG4
TRISG3
TRISG2
TRISG1
TRISG0
60
TMR1L
Timer1 Register Low Byte
58
TMR1H
Timer1 Register High Byte
58
T1CON
RD16
T1RUN
T1CKPS1 T1CKPS0 T1OSCEN T1SYNC TMR1CS TMR1ON
58
TMR3H
Timer3 Register High Byte
59
TMR3L
Timer3 Register Low Byte
59
T3CON
RD16
T3CCP2 T3CKPS1 T3CKPS0 T3CCP1
T3SYNC TMR3CS TMR3ON
59
CCPR1L
Capture/Compare/PWM Register 1 Low Byte
60
CCPR1H
Capture/Compare/PWM Register 1 High Byte
60
CCP1CON
—
DC1B1
DC1B0
CCP1M3 CCP1M2 CCP1M1 CCP1M0
60
CCPR2L
Capture/Compare/PWM Register 2 Low Byte
61
CCPR2H
Capture/Compare/PWM Register 2 High Byte
61
CCP2CON
—
DC2B1
DC2B0
CCP2M3 CCP2M2 CCP2M1 CCP2M0
61
Legend: — = unimplemented, read as ‘0’. Shaded cells are not used by Capture/Compare, Timer1 or Timer3.
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